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利用D触发器构成计数器

硬件笔试常见的题目

数字电路实验设计:

D触发器组成的4位异步二进制加法计数器

一、选用芯片74LS74,管脚图如下:

利用D触发器构成计数器

说明:74LS74是上升沿触发的双D触发器, D触发器的特性方程为

二、设计方案:

用触发器组成计数器。触发器具有0 和1两种状态,因此用一个触发器就可以表示一位二进制数。如果把n个触发器串起来,就可以表示n位二进制数。对于十进制计数器,它的10 个数码要求有 10 个状态,要用4位二进制数来构成。下图是由D触发器组成的4位异步二进制加法计数器。

利用D触发器构成计数器

三、实验台:

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